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Pérez Carballo, Pedro Francisco

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Tipo: trabajo final de máster

Título Año
Implementación Mpsoc Fpga De Algoritmos De Machine Learning Para Aplicaciones Clínicas Usando Metodologías De Diseño De Alta Nivel Guanche Hernández, Mario Daniel Director/a: Pérez Carballo, Pedro Francisco ; León Martín, Sonia Raquel Titulación: Máster Universitario en Electrónica y Telecomunicación Aplicadas por la Universidad de Las Palmas de Gran Canaria Fecha de publicación: 2023 Trabajo final de máster
Desarrollo De Una Plataforma Software Empotrada Basada En Soc Fpga Zynq Para Apliacaciones De Astrofísica Miranda Guillén, David Serafín Director/a: Pérez Carballo, Pedro Francisco Titulación: Máster Universitario en Electrónica y Telecomunicación Aplicadas por la Universidad de Las Palmas de Gran Canaria Fecha de publicación: 2023 Trabajo final de máster
Metología De Diseño De Sistemas De Control Para Dispositivos Soc Fpga Santana Quintana, Gabriel Director/a: Pérez Carballo, Pedro Francisco ; Betancor Martín, Carlos Salvador Titulación: Máster Universitario en Electrónica y Telecomunicación Aplicadas por la Universidad de Las Palmas de Gran Canaria Fecha de publicación: 2022 Trabajo final de máster
Sistema Basado En Soc Fpga Zynq Para Aplicaciones En El Campo De La Astrofísica Medina Hernández, Selenia María Director/a: Pérez Carballo, Pedro Francisco ; Hernández Fernández, Pedro ; González Martín-Feránandez, Sergio Titulación: Máster Universitario en Electrónica y Telecomunicación Aplicadas por la Universidad de Las Palmas de Gran Canaria Fecha de publicación: 2022 Trabajo final de máster
Aceleración Hardware De Clasificación De Tráfico Tcp/Ip Cifrado Mediante Técnicas De Machine Learning Picallo Martínez, Samuel Director/a: Pérez Carballo, Pedro Francisco ; Núñez Ordóñez, Antonio ; León Martín, Sonia Raquel Titulación: Máster Universitario en Tecnologías de Telecomunicación Fecha de publicación: 2019 Trabajo final de máster
Aceleración hardware de clasificación de tráfico TCP/IP cifrado mediante técnicas de Machine Learning Picallo Martínez, Samuel Director/a: Pérez Carballo, Pedro Francisco ; Leon Martin, Sonia Raquel ; Núñez Ordóñez, Antonio Titulación: Grado en Ingeniería en Tecnologías de la Telecomunicación Fecha de publicación: 2019 Trabajo final de máster
Desarrollo de una Plataforma Virtual de un acelerador hardware FPGA para DPI León Martín, Sonia Raquel Director/a: Pérez Carballo, Pedro Francisco ; Núñez Ordóñez, Antonio Titulación: Máster Universitario en Tecnologías de Telecomunicación Fecha de publicación: 2018 Trabajo final de máster
Plataforma FPGA PCI Express para aplicaciones Big Data González Crespo, Irene Director/a: Núñez Ordóñez, Antonio ; Pérez Carballo, Pedro Francisco Titulación: Máster Universitario en Tecnologías de Telecomunicación Fecha de publicación: 2018 Trabajo final de máster
Análisis y diseño de aceleradores hardware sobre SoC basados en FPGA orientados a aplicaciones de seguridad en Internet de las cosas Barrios Alfaro, Yubal Director/a: Pérez Carballo, Pedro Francisco ; Núñez Ordóñez, Antonio Titulación: Máster Universitario en Tecnologías de Telecomunicación Fecha de publicación: 2017 Trabajo final de máster
Diseño e implementación de una arquitectura MapReduce para aplicaciones Big Data mediante síntesis de alto nivel Spahr, Julian Director/a: Pérez Carballo, Pedro Francisco ; Núñez Ordóñez, Antonio Titulación: Máster Universitario en Tecnologías de Telecomunicación Fecha de publicación: 2017 Trabajo final de máster
Diseño e implementación mediante síntesis de alto nivel de un IP para el filtrado y clasificación de paquetes TCP/IP Vega Del Pino, Benjamin Director/a: Núñez Ordóñez, Antonio ; Pérez Carballo, Pedro Francisco Titulación: Máster Universitario en Tecnologías de Telecomunicación Fecha de publicación: 2016 Trabajo final de máster
Síntesis de alto nivel basada en Xilinx Vivado para aceleradores hardware Domínguez Hernández, Adrián Director/a: Núñez Ordóñez, Antonio ; Pérez Carballo, Pedro Francisco Titulación: Máster Universitario en Tecnologías de Telecomunicación Fecha de publicación: 2014 Trabajo final de máster
Estudio y análisis del codificador y decodificador de vídeo H.265/ HEVC García Quintana, Lidia Esther Director/a: Pérez Carballo, Pedro Francisco Titulación: Máster Universitario en Ingeniería de Telecomunicación Fecha de publicación: 2014 Trabajo final de máster
Streaming de vídeo H.264 con el protocolo RTMP en un dispositivo empotrado Santana Abril, Judith Director/a: Pérez Carballo, Pedro Francisco Titulación: Máster Universitario en Ingeniería de Telecomunicación Fecha de publicación: 2014 Trabajo final de máster
Prototipado sobre plataforma fpga de un deblocking filter para h.264/svc Espino Santana, Omar Director/a: Núñez Ordóñez, Antonio ; Pérez Carballo, Pedro Francisco Titulación: Máster Universitario en Tecnologías de Telecomunicación Fecha de publicación: 2013 Trabajo final de máster
Síntesis de alto nivel de un decodificador H.264/AVC sobre plataforma FPGA Neris Tomé, Romén Director/a: Núñez Ordóñez, Antonio ; Pérez Carballo, Pedro Francisco Titulación: Máster Universitario en Tecnologías de Telecomunicación Fecha de publicación: 2012 Trabajo final de máster