Identificador persistente para citar o vincular este elemento: http://hdl.handle.net/10553/77483
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dc.contributor.advisorSarmiento Rodríguez, Roberto-
dc.contributor.advisorLópez Feliciano, José Francisco-
dc.contributor.authorGarcía Del Toro, Aday-
dc.date.accessioned2021-02-03T09:11:25Z-
dc.date.available2021-02-03T09:11:25Z-
dc.date.issued2012-
dc.identifier.othercontentdm-postulpgc-
dc.identifier.urihttp://hdl.handle.net/10553/77483-
dc.descriptionMáster Universitario en Ingeniería de Telecomunicación-
dc.description.abstractEl objetivo del presente Trabajo Fin de Máster (TFM) es la implementación, verificación y síntesis sobre una FPGA del algoritmo con pérdidas LCE. El resultado de este trabajo es por lo tanto un código RTL sintetizable en el lenguaje de descripción hardware VHDL (VHSIC Hardware Description Language). Para llevar a cabo este trabajo es necesario el uso de varias herramientas software. Como entradas a este trabajo, ha sido necesario el estudio, en primer lugar, del estado del arte sobre algoritmos de compresión de imágenes hiperespectrales, en especial el algoritmo LCE. Asimismo, para esta implementación se ha partido del código de referencia proporcionado por la Universidad Politécnica de Torino escrito en el lenguaje de alto nivel C/C++. Este código de referencia ha sido previamente modificado con el fin de lograr una mayor aproximación al hardware empleando tipos de datos con resolución a nivel de bit (Algoritmic C data types), reduciendo el número de variables por constantes, evitando las operaciones matemáticas en punto flotante, eliminando accesos a memoria innecesarios y optimizando bucles. Para mayor información de este trabajo previo sobre el código de referencia consultar: L. Santos, LCE GPU Implementation Report. ESA Standard Document. Mediante las entradas descritas, se ha procedido a realizar una separación del código en ANSI C de las funciones que lo componen con el objetivo de obtener mediante la herramienta de síntesis de alto nivel, High Level Synthesis (HLS), Catapult C obtener el código RTL sintetizable escrito en VHDL de cada uno de los módulos. En este punto se emplea la herramienta de diseño, simulación y depuración ModelSim con el fin de diseñar y verificar la unidad de control hardware que será la encargada de la conexión y gestión de los flujos de datos de cada uno de los módulos generados. Finalmente, mediante el empleo de la herramienta Precision Synthesis, se realiza la síntesis de todo el algoritmo de compresión obtenido extrayendo los resultados de la misma. Estos resultados se comparan con los obtenidos en trabajos anteriores: L. Santos, LCE GPU Implementation Report. ESA Standard Document.-
dc.format3238709 Bytes-
dc.languagespa-
dc.rightsAcceso restringido para la comunidad universitaria de la ULPGC-
dc.subject3325 Tecnología de las telecomunicaciones-
dc.titleTécnicas de compresión de imágenes hiperespectrales para aplicaciones espaciales-
dc.typeinfo:eu-repo/semantics/masterThesis-
dc.typeMasterThesis-
dc.contributor.centroIU de Microelectrónica Aplicada-
dc.contributor.facultadEscuela de Ingeniería de Telecomunicación y Electrónica-
dc.identifier.absysnet720030-
dc.investigacionIngeniería y Arquitectura-
dc.type2Trabajo final de máster-
dc.description.notasMáster en Tecnologías de Telecomunicación-
dc.utils.revision-
dc.identifier.matriculaTFT-26155-
dc.identifier.ulpgc-
dc.contributor.buulpgcBU-TEL-
dc.contributor.titulacionMáster Universitario en Tecnologías de Telecomunicación-
item.fulltextCon texto completo-
item.grantfulltextopen-
crisitem.advisor.deptGIR IUMA: Diseño de Sistemas Electrónicos Integrados para el procesamiento de datos-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
crisitem.advisor.deptGIR IUMA: Diseño de Sistemas Electrónicos Integrados para el procesamiento de datos-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
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