Identificador persistente para citar o vincular este elemento: http://hdl.handle.net/10553/77472
Campo DC Valoridioma
dc.contributor.advisorNúñez Ordóñez, Antonioes
dc.contributor.advisorPérez Carballo, Pedro Franciscoes
dc.contributor.authorGonzález Crespo, Irenees
dc.date.accessioned2021-02-02T13:36:14Z-
dc.date.available2021-02-02T13:36:14Z-
dc.date.issued2018en_US
dc.identifier.urihttp://hdl.handle.net/10553/77472-
dc.description.abstractEste Trabajo Fin de Máster está formado por dos partes fundamentales. La primera se centra en la implementación del bus de comunicaciones PCI Express para facilitar una comunicación rápida, eficaz y eficiente entre la placa de prototipado FPGA y el host controlador del sistema. Obteniendo así una plataforma FPGA que utiliza PCI Express como interfaz de datos. La segunda se centra en el desarrollo de un clasificador de datos apto para aplicaciones de Big Data, permitiendo trabajar con datos en tiempo real. Por ello, se procede a la combinación de ambas partes en un sistema de procesamiento para Big Data, aunque se permite que el diseño pueda ser reutilizado para otros tipos de aplicaciones (DPI, CEP, …). La implementación del sistema se ha realizado sobre la placa de desarrollo de Xilinx ZC706. Inicialmente, se describe el bus de comunicaciones PCI Express, con todas las particularidades que lo caracterizan y su funcionamiento. De esta manera, se tiene una visión clara de las amplias bases que cubre y los beneficios que aporta a un sistema. A continuación, se explica el bloque utilizado para su implementación, RIFFA. Se tratan sus características principales y su arquitectura, para posteriormente proceder a su implementación y los pasos necesarios para adaptarlo a la FPGA utilizada. También, se realiza un breve estudio de los diferentes clasificadores estudiados, los cuales pueden ser implementados en diferentes aplicaciones Big Data, haciendo especial hincapié en el seleccionado para el desarrollo de este proyecto. El clasificador escogido se basa en el algoritmo de bitonic sorting, del cual se muestra su arquitectura y los cambios realizados para su posterior implementación sobre la FPGA. Finalmente, se realiza la implementación del sistema completo sobre la FPGA, incluyendo el bus de comunicaciones PCI Express y el clasificador de bitonic sorting, incluyendo las fases de verificación y validación del sistema. Como conclusión, se puede observar que se consiguen elevadas tasas de transmisión de datos gracias a la implementación del bus de comunicaciones PCI Express a través de RIFFA y se obtiene un sistema completo apto para aplicaciones de Big Data. El sistema es capaz de trabajar en tiempo real y con elevadas tasas de transmisión, obteniendo un sistema funcional, fiable y efectivo.en_US
dc.languagespaen_US
dc.subject3325 Tecnología de las telecomunicacionesen_US
dc.titlePlataforma FPGA PCI Express para aplicaciones Big Dataes
dc.typeinfo:eu-repo/semantics/masterThesisen_US
dc.typeMasterThesisen_US
dc.contributor.centroIU de Microelectrónica Aplicadaen_US
dc.contributor.departamentoDepartamento de Ingeniería Electrónica Y Automáticaes
dc.contributor.facultadEscuela de Ingeniería de Telecomunicación y Electrónicaen_US
dc.investigacionIngeniería y Arquitecturaen_US
dc.type2Trabajo final de másteren_US
dc.utils.revisionen_US
dc.identifier.matriculaTFT-42625es
dc.identifier.ulpgcen_US
dc.contributor.buulpgcBU-TELes
dc.contributor.titulacionMáster Universitario en Tecnologías de Telecomunicaciónes
item.grantfulltextopen-
item.fulltextCon texto completo-
crisitem.advisor.deptGIR IUMA: Sistemas de Información y Comunicaciones-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
crisitem.advisor.deptGIR IUMA: Sistemas de Información y Comunicaciones-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
Colección:Trabajo final de máster
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