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Investigador:
sosa gonzález, carlos javier
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artículo
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Título
Año
Application of genetic algorithm in computing the tradeoffs between power consumption versus delay in digital integrated circuit design
Sosa, J.
; Montiel-Nelson, Juan A.
; Nooshabadi, Saeid
Fecha de publicación: 2010
DOI:
10.1016/j.mejo.2010.01.010
Localización:
Microelectronics Journal[ISSN 0026-2692],v. 41, p. 135-141
JCR:
0,789
-
Q3
SCIE
Artículo
A low power voltage limiter for a full passive UHF RFID sensor on a 0.35 μm CMOS process
Fernández, E.; Beriain, A.; Solar, H.; Rebollo, I.; García-Alonso, A., et al.
Fecha de publicación: 2012
DOI:
10.1016/j.mejo.2012.03.013
Localización:
Microelectronics [ISSN 0026-2692], v. 43 (10), p. 708-713, (Octubre 2012)
JCR:
0,912
-
Q3
SCIE
Artículo
Analysis and optimization of dynamically reconfigurable regenerative comparators for ultra-low power 6-bit TC-ADCs in 90 nm CMOS technologies
Montiel-Nelson, Juan A.
; Navarro, Víctor
; Sosa, Javier
; Bautista, Tomás
Fecha de publicación: 2014
DOI:
10.1016/j.mejo.2014.02.005
Localización:
Microelectronics Journal[ISSN 0026-2692],v. 45, p. 1247-1253
JCR:
0,836
-
Q3
SCIE
Artículo