Please use this identifier to cite or link to this item: http://hdl.handle.net/10553/75891
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dc.contributor.advisorPérez Carballo, Pedro Franciscoes
dc.contributor.advisorLeón Martín, Sonia Raqueles
dc.contributor.advisorPicallo Martínez, Samueles
dc.contributor.authorSantos Ruiz, Romarey Lourdeses
dc.date.accessioned2020-11-24T13:16:51Z-
dc.date.available2020-11-24T13:16:51Z-
dc.date.issued2020en_US
dc.identifier.urihttp://hdl.handle.net/10553/75891-
dc.description.abstractEste trabajo final de grado se centra en el estudio de la metodología PYNQ mediante la cual es posible la utilización de dispositivos SoC FPGA de tipo Zynq y MPSoC Zynq Ultrascale+ para la implementación de soluciones hardware/software a partir del lenguaje Python. Se realiza un estudio de las metodologías de diseño para la creación de IPs desde especificaciones de alto nivel. Seguidamente, se aborda el estudio del modelo de uso y de la metodología de diseño PYNQ para distintos aspectos teóricos y prácticos tales como la creación de overlays y otros aspectos de reconfiguración del sistema. Se dan detalles de overlays estandarizados, de las distintas bibliotecas Python y de las placas de prototipado que dan soporte a la metodología. Para comprobar la metodología se aplica al caso del algoritmo de búsqueda de patrones Boyer Moore, introduciendo el método de procesamiento de patrones que utiliza. Por último, se lleva a cabo la descripción de la solución final para el diseño de la plataforma donde se realiza la validación del sistema desde el punto de vista funcional de los resultados obtenidos comparándolos con la aplicación de referencia. Asimismo, se realizan distintas medidas de consumo de potencia, utilización de recursos y latencia. Desde el punto de vista de la curva del aprendizaje, se ha visto que, para obtener el máximo rendimiento de la metodología, además de conocer las técnicas de programación en Python, el diseñador debe conocer la arquitectura del dispositivo Zynq, la metodología de diseño para plataformas FPGA y el desarrollo de software empotrado para arquitecturas ARM Cortex A9. En caso contrario, el diseñador se limita a los overlays disponibles, no alcanzando el máximo rendimiento al dispositivo Zynq. Una vez que se ha creado el correspondiente overlay optimizado, la creación de la aplicación es rápida y se apoya en las técnicas de programación y paquetes disponibles en Python. El proceso es completamente interactivo, pudiendo apoyarse en la carga de sucesivos overlays en función de las necesidades de cómputo reales.en_US
dc.languagespaen_US
dc.subject3325 Tecnología de las telecomunicacionesen_US
dc.titleDesarrollo rápido de aplicaciones con Python para procesamiento heterogéneo sobre SoC FPGA PYNQ-Z1es
dc.typeinfo:eu-repo/semantics/bachelorThesisen_US
dc.typeBachelorThesisen_US
dc.contributor.facultadEscuela de Ingeniería de Telecomunicación y Electrónicaen_US
dc.investigacionIngeniería y Arquitecturaen_US
dc.type2Trabajo final de gradoen_US
dc.description.notasMención: Sistemas Electrónicosen_US
dc.identifier.ulpgcen_US
dc.contributor.buulpgcBU-TELes
item.grantfulltextrestricted-
item.fulltextCon texto completo-
crisitem.advisor.deptGIR IUMA: Sistemas de Información y Comunicaciones-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
crisitem.advisor.deptGIR IUMA: Diseño de Sistemas Electrónicos Integrados para el procesamiento de datos-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
Appears in Collections:Trabajo final de grado
Restringido ULPGC
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