Please use this identifier to cite or link to this item: http://hdl.handle.net/10553/62863
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dc.contributor.advisorLópez Suárez, Sebastián-
dc.contributor.advisorTobajas Guerrero, Félix Bernardo-
dc.contributor.authorHernández Sáiz, Ruperto J.-
dc.date.accessioned2020-01-21T10:31:51Z-
dc.date.available2009-06-30T00:00:00Z-
dc.date.available2020-01-21T10:31:51Z-
dc.date.issued2008-
dc.identifier.othercontentdm-postulpgc-
dc.identifier.urihttp://hdl.handle.net/10553/62863-
dc.formatPDF-
dc.format.mimetypeKODAK i660-
dc.format.mimetype300 ppp., TIFF sin compresión-
dc.format.mimetype1 bit (blanco y negro)-
dc.languagespa-
dc.rightsAcceso restringido para la comunidad universitaria de la ULPGC-
dc.subject3325 Tecnología de las telecomunicaciones-
dc.subject.otherElectrónica-
dc.subject.otherTelecomunicaciones-
dc.titleParalelización de un decodificador H.264/AVC sobre una arquitectura multiprocesadora-
dc.typeinfo:eu-repo/semantics/studentThesis-
dc.typeStudentThesis-
dc.identifier.absysnet541999-
dc.type2Proyecto fin de carrera-
dc.identifier.currens2307-
dc.description.numberofpages221 p.-
dc.utils.revision-
dc.identifier.matriculaTFT-19317-
dc.identifier.ulpgc-
dc.contributor.buulpgcBU-TEL-
dc.contributor.titulacionIngeniero de Telecomunicación-
item.fulltextCon texto completo-
item.grantfulltextrestricted-
crisitem.advisor.deptGIR IUMA: Diseño de Sistemas Electrónicos Integrados para el procesamiento de datos-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
crisitem.advisor.deptGIR IUMA: Sistemas de Información y Comunicaciones-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
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Restringido ULPGC
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