Please use this identifier to cite or link to this item: http://hdl.handle.net/10553/10732
DC FieldValueLanguage
dc.contributor.advisorDel Pino Suárez, Francisco Javieres
dc.contributor.advisorLalchand Khemchandani, Suniles
dc.contributor.advisorHernández Ballester, Antonioes
dc.contributor.authorPulido Medina, Jesús Rubénes
dc.contributor.otherInstituto Universitario de Microelectrónica Aplicada (IUMA)
dc.date.accessioned2013-09-20T05:00:08Z
dc.date.accessioned2018-06-05T11:36:53Z-
dc.date.available2013-09-20T05:00:08Z
dc.date.available2018-06-05T11:36:53Z-
dc.date.issued2013es
dc.identifier.urihttp://hdl.handle.net/10553/10732
dc.descriptionPrograma de doctorado: Ingeniería de telecomunicación avanzada.es
dc.description.abstract[ES] El principal objetivo de esta tesis es el estudio y desarrollo de un sintetizador fraccional basado en un modulador Sigma Delta para el estándar DVB-SH. Para tal fin se ha utilizado la tecnología UMC 90 MM de Europractige. Dicho desarrollo incluye la elección y estudio de la arquitectura del sintetizador, el diseño de los bloques que la componen, la optimización de dichos circuitos y su posterior medida. Para ello se ha abordado el diseño del sintetizador desde cero, desde el establecimiento de las especificaciones iniciales de cada elemento de forma razonada, hasta la implementación y medida de los bloques que lo conforman. Se ha intentado minimizar el área, consumo, número de componentes pasivos y externos. Dicho sintetizador posee dicha topología dado la no viabilidad de gestionar toda la canalización que permite DVB-SH con un único valor entero de reloj. Los bloques que conforman el sintetizador son el VCO, el divisor rápido entre 2, el divisor programablr, el modulador Sigma Delta, el comparador de faso y el filtro de bucle. Todos estos bloques poseen estructuras y técnicas no convencionales, ya que han sido optimizados de acuerdo con el objetivo de maximizar sus prestaciones con el menor consumo posible. Entre estas técnicas de optimización están el uso de realimentadores de corriente en el caso del VCO, el empleo de una única red de reloj para el divisor rápido, metodologías de polarizaión en regiones subumbrales (gm/ID) en el modulador Sigma Delta o eliminación de la zona muerta en el comparador de fase.es
dc.formatapplication/pdfes
dc.languagespaes
dc.rightsby-nc-ndes
dc.subject330703 Diseño de circuitoses
dc.subject330790 Microelectrónicaes
dc.subject330791 Microelectrónica. Tecnología del silicioes
dc.subject330793 Microelectrónica. Diseñoes
dc.subject.otherMicroelecctrónicaes
dc.subject.otherModulaciónes
dc.titleSigma Delta frequency synthesizer for DVB-SHes
dc.typeinfo:eu-repo/semantics/doctoralThesises
dc.typeThesises
dc.compliance.driver1es
dc.contributor.departamentoDepartamento de Iu De Microelectrónica Aplicadaes
dc.identifier.absysnet686811es
dc.investigacionIngeniería y Arquitecturaes
dc.rights.accessrightsinfo:eu-repo/semantics/openAccesses
dc.type2Tesis doctorales
dc.identifier.matricula1077051es
dc.identifier.ulpgces
dc.contributor.programaIngeniería De Telecomunicación Avanzadaes
item.grantfulltextopen-
item.fulltextCon texto completo-
crisitem.author.fullNamePulido Medina, Jesús Rubén-
crisitem.advisor.deptIUMA Sistemas de Información y Comunicaciones-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
crisitem.advisor.deptIUMA Sistemas de Información y Comunicaciones-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
crisitem.advisor.deptIUMA Sistemas de Información y Comunicaciones-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
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