Please use this identifier to cite or link to this item: http://hdl.handle.net/10553/77566
DC FieldValueLanguage
dc.contributor.advisorDe Armas Sosa, Valentínes
dc.contributor.advisorTobajas Guerrero, Félix Bernardoes
dc.contributor.authorSánchez López-Trejo, José Davides
dc.date.accessioned2021-02-08T08:58:09Z-
dc.date.available2021-02-08T08:58:09Z-
dc.date.issued2019en_US
dc.identifier.urihttp://hdl.handle.net/10553/77566-
dc.languagespaen_US
dc.subject3325 Tecnología de las telecomunicacionesen_US
dc.titleDesarrollo de un entorno de verificación basado en UVM Frameworkes
dc.typeinfo:eu-repo/semantics/masterThesisen_US
dc.typeMasterThesisen_US
dc.contributor.departamentoDepartamento de Ingeniería Electrónica Y Automáticaes
dc.contributor.facultadEscuela de Ingeniería de Telecomunicación y Electrónicaen_US
dc.investigacionIngeniería y Arquitecturaen_US
dc.type2Trabajo final de másteren_US
dc.identifier.matricula51757es
dc.identifier.ulpgcen_US
dc.contributor.buulpgcBU-TELes
dc.contributor.titulacionMáster Universitario en Ingeniería de Telecomunicaciónes
item.grantfulltextrestricted-
item.fulltextCon texto completo-
crisitem.advisor.deptGIR IUMA Sistemas de Información y Comunicaciones-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
crisitem.advisor.deptGIR IUMA Sistemas de Información y Comunicaciones-
crisitem.advisor.deptIU de Microelectrónica Aplicada-
crisitem.advisor.deptDepartamento de Ingeniería Electrónica y Automática-
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