Please use this identifier to cite or link to this item: http://hdl.handle.net/10553/125811
Title: Diseño De Un Sistema Hardware Para Compresión De Datos A Una Tasa De 8 Gbps Basado En El Estándar Ccsds 121.0-B-3
Authors: Torres Fau,Samuel 
Director: Sarmiento Rodríguez, Roberto 
Sánchez Clemente, Antonio José 
Issue Date: 2023
Department: Departamento de Ingeniería Electrónica y Automática
Degree: Máster Universitario en Electrónica y Telecomunicación Aplicadas por la Universidad de Las Palmas de Gran Canaria
URI: http://hdl.handle.net/10553/125811
Appears in Collections:Trabajo final de máster

En el caso de que no encuentre el documento puede ser debido a que el centro o las/os autoras/es no autorizan su publicación. Si tiene verdadero interés en el contenido del mismo, puede dirigirse al director/a o directores/as del trabajo cuyos datos encontrará más arriba.

Show full item record

Google ScholarTM

Check


Share



Export metadata



Items in accedaCRIS are protected by copyright, with all rights reserved, unless otherwise indicated.